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verilog - 如何在 Verilog 中创建闩锁
我有一个带有代表重置按钮的数字输入的 CPLD。当按下复位按钮时,信号变为高电平。我需要做的是有一个寄存器,它的值告诉按钮是否被按下。基本上是一个闩锁。当按钮变为高电平时,锁存寄存器变为高电平并永远保持高电平。
我认为这很简单,但是当我尝试对其进行编码时,我收到了一堆警告。一点谷歌搜索显示“不要在 HDL 中制作闩锁!不好的做法!”,但我在这里并没有真正看到替代方案。
这是我的尝试。clk_10m 是一个快速自由运行的时钟,pwr_off_req 是按钮输入。
vhdl - VHDL等待多个信号
如果 a 和 b 同时改变它们的值会发生什么,例如 2ns。
进程会触发2次吗?
如果是这样,应该为 a,b 使用哪些值,如果我们要通过 a 事件的进程,b 信号是在那个时候改变了,还是当进程再次为 b 运行时它会改变?
还有声明 c <= a and b after 1ns; 在过程之外,它如何与之后一起工作?如果没有之后,它只是一个 AND 单元,没有延迟。
verilog - 如何创建可执行的 PrimeTime 脚本?
在为 Synopsys PrimeTime 创建脚本时,我发现的教程通过加载工具 (pt_shell) 然后获取脚本来执行脚本。
要运行脚本:
示例脚本:
如何制作将启动 PrimeTime (pt_shell) 然后运行命令的可执行脚本?
例子来自这里。
hardware - 如何连接不同的 Verilog 模块?
我正在做一个反应计时器。我之前已经制作了单独的模块,现在剩下的就是集体使用它们。
在其他语言中,它们用作返回值的函数。在这里,我了解模块已实例化。我知道如何实例化,就像我为 LFSR 所做的那样,但对于 LED 多路复用器,我不知道该怎么做。
这是我的 LFSR 代码,它将被实例化到主模块中:
这是主要模块。在某些地方,我必须调用 LED 电路来显示“Hi”,然后再显示秒表。我已经用评论标记了它们。我该怎么做?
现在我已经做了一个工作秒表。它写在下面:
我希望我能够解释我的问题。
感谢您阅读
更新代码:
hardware - 为什么这个伪随机数生成器 (LFSR) 的输出如此可预测?
最近我在这里问,如何在硬件中生成随机数,并被告知使用 LFSR。这将是随机的,但会在某个值后开始重复。
问题是生成的随机数是如此可预测,以至于下一个值很容易被猜到。例如检查下面的模拟:
下一个“随机”数字可以通过将前一个数字与自身 +1 相加来猜测。有人可以验证这是否正常且可以预期。
这是我用于 LFSR 的代码:
异或位的位置取自这里:表格第 5 页
vhdl - xilinx VHDL 错误 827:信号无法合成
我是 VHDL 编程的初学者,我正在尝试使用 ISE 项目导航器 13.1 合成以下 vhdl 代码(用于按钮的软件)
但不幸的是,我遇到了以下错误:
错误:Xst:827 -“.../digital lab II 110/PBdebouncer/PBdebouncer.vhd”第 43 行:无法合成信号启用,同步描述错误。当前软件版本不支持您用于描述同步元素(寄存器、内存等)的描述样式。
那么你能帮我解释一下这个错误吗?
function - VHDL位旋转函数语法错误?
我这样做是为了我的学校工作,我正在制作自己的滚动/移位功能。下面是我写的代码,但是当我尝试编译它时,我在 rownum<=rol(rowcount,1); 上得到语法错误
floating-point - 前导零计数器
我正在为浮点实现标准化单元,我想知道如何有效地实现前导零计数器?
我知道我可以写以下内容,但我想知道如果我的目标是低面积和高能效,是否有更好的方法?:
reference - 非法引用错误
我正在使用 D-Flip Flops 编写波纹计数器。然而,下面的代码给了我变量的Illegal reference error
内部initial
块。q2,q3,q4
这是为什么?
D 触发器模块:
我怎么解决这个问题?
问候