问题标签 [riscv]
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microcontroller - 微处理器设计中有哪些新的架构研究？
在浏览研究论文时，我觉得微处理器架构几乎已经饱和。谁能解释一下微处理器设计中发生的新研究。
chisel - 凿子工具安装；无法找到 scct
我正在尝试开始使用 Chisel。按照 Chisel 网页上的说明，我安装了 scala 2.11 和 sbt，复制了 build.sbt 和 Hello World 示例。但是，我无法运行该示例。我收到以下错误。
fpga - Zybo构建fpga的利用
我想知道如果我们使用 Rocket core 的股票实现（带 FP），使用了多少 Zybo fpga 板的资源。如果它已经是 60%，那么如果我打算添加一些说明，那么从 Zybo 板开始可能没有意义。
gcc - 如何为 RV32I 编译 dhrystone 基准测试
当我尝试在 riscv-sodor 中为 -march RV32I 编译 dhrystone 基准测试时，无法识别的操作码“amoadd”错误退出编译。
有没有办法为 RV32I 的裸机硬件编译 dhrystone。
riscv - 未对齐的指令访问——spike pk hello
在测试我的 RISC-V 工具链时，我收到“未对齐的指令访问”异常。hello.c 的内容与 README 文件中提供的示例相匹配。
有没有人遇到过这个问题？
riscv - FENCE 在 RISC-V Rocket 处理器中的实现
Rocket CPU 中的 FENCE 指令有什么作用？我尝试通过 fpga 源但找不到它。
另外，写缓冲区在哪里实现？我可能会在那里得到答案:)
toolchain - 使用特定指令集设置 RISC-V 工具链
我正在使用一种形式的 RISC-V ISA 开发处理器，并且我目前正在尝试设置工具链。我当前的处理器设计使用 RV32I 基本指令集，我想为此 ISA 进行编译。然而，工具链的默认配置，如 http://RISCV.org 站点上所写，是为 RV64I ISA 编译的。
如何重新配置此工具链以生成 RV32I ISA 的二进制文件？
riscv - RISC-V Rocket-Chip 周期精确的 C++ 仿真器失败并出现“std::bad_alloc”错误
我尝试按照github上的说明测试 RISC-V Rocket-Chip 周期准确的 C++ 仿真器，但出现如下所示的错误。
“output/rv64ui-p-amoadd_w.out”的内容是：
我发现程序在mm_t初始化时发疯了。
这段代码会占用 4GB 内存，如果失败，程序会突然死掉。
linux - RISCV的交叉编译
我有一个 C 程序，我想为RISCV ISA编译它。我已按照他们的说明安装工具。他们的工具工作正常，我可以编译一个“Hello world！” C 程序并运行它。但现在我想编译另一个包含多个文件的 C 程序。我试图更改makefile，而不是使用gcc，而是用他们的编译器名称替换它，riscv64-unknown-linux-gnu-gcc但我得到了：
Relocations in generic ELF (EM: 62)
错误，然后我尝试设置CC = riscv64-unknown-linux-gnu-gcc，但我收到另一个错误pthread
unrecognized command line option '-pthread'
我的问题是我应该更改 make 文件以使用他们的编译器吗？
提前感谢您的帮助。
riscv - 使用 Spike 调试简单的 C 和汇编程序 (riscv-isa-sim)
我在穗上运行简单的 C 和汇编程序（这工作正常）。我无法运行尖峰调试模式。尽管我正在尝试调试不同的程序，但我总是得到相同的输出。我正在使用 riscv64-unknown-elf-gcc 从 C 和汇编代码生成可执行二进制文件，并且还描述了以下命令：http ://riscv.org/download.html#tab_isa-sim运行调试模式：
如果我只输入以下内容，我也会得到相同的输出：
如果我键入以下命令（不带 pk），我会收到错误消息：