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我想测试verilog模块的所有可能输入组合。我已经能够通过构建一个带有嵌套 for 循环的数组来生成这些输入。但是我想以随机顺序遍历数组。如何做到这一点,或者有没有办法生成一个包含所有可能输入的数组,这些输入已经是随机顺序的?

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如果您想重新排列测试用例列表,例如洗牌,有一种称为Fisher-Yates 洗牌的算法可以做到这一点。或者,如果您使用的是 SystemVerilog,toolic 指出有一个内置的shuffle数组方法。

于 2011-05-18T15:06:30.383 回答