verilog - 如何使用verilog代码消除信号延迟

Question

我有一个从 1400ns 开始到 2000ns 结束的数据信号。我希望该信号从 100ns 开始。如何在 verilog 中做到这一点？请帮助我。我是 verilog 代码的新手。

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您能否发布您的代码，以便于查看问题。此外，您是否打算做一个可综合的 verilog 代码，因为延迟是不可综合的。

假设它是测试台的一部分，我会做这样的事情

initial
   #100 signal = value;
   ...

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