debugging - 如何在 Modelsim 中重新启动 Verilog 仿真

Question

我正在尝试调试 Verilog 模块。我发现必须停止模拟，修改代码，然后重新开始模拟的过程很乏味。有没有更简单的方法？

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它被称为restart:-) 模拟 -> 运行 -> 重启

于 2011-03-10T22:58:13.693 回答

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这是我的首选单行代码，便于迭代：

要开始仿真并创建波形：

vlog your_file.v; vsim work.your_TB; add wave -position insertpoint sim:/your_TB/*;

更新代码和测试新迭代时：

vcom your_file.v; restart -f; run -A;

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如果设计和/或测试平台发生了变化，仅靠 ModelSim 的“重新启动”命令是不够的，因为它只会重新绘制最后一次仿真。

设计和测试平台需要重新编译以考虑所有更改。

通常设计没有改变，您只想在更新的测试平台上运行它。在这种情况下，您可以通过执行自定义脚本来重新开始模拟，您可以在需要时使用“do {script-name}”命令调用该脚本。

vlog -reportprogress 300 -work work testbench.v
restart -f
run 1us

假设：testbench 文件 = testbench.v；模拟时间 = 1us

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