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我是 Yosys 和综合的新手,但我想要实现的是在设计单元经过综合后获得门和晶体管的数量。我该如何做到这一点?
您可以stat用于门计数统计、stat -lib自由文件的面积统计或stat -tech cmos使用 CMOS 型门的晶体管计数。
stat
stat -lib
stat -tech cmos