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是否可以将Chisel HDL与 CPLD 一起使用?如果是的话,你试过了吗,可以分享一下经验吗?

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由于 Chisel 生成 Verilog 代码并且 CPLD 接受 Verilog 进行综合,是的,这是可能的。我用 Xilinx 的 CoolRunnerII 对其进行了测试。效果很好。

于 2016-05-04T06:53:22.163 回答