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每当“clk”更改为“1”时，我正在编码将“d”的值放入“z”。

例如，

clk=0 d=        15, z=         x
clk=1 d=        20, z=        20
clk=0 d=        25, z=        20
clk=1 d=        30, z=        30

只要 clk 为“1”，它就会将“d”的值放入“z”。

所以下面是对随机数重复 20 次的代码。

module lab9;
reg [31:0] d;
reg clk, enable, flag;
wire [31:0] z;
reg [31:0] e;
register #(32) mine(z, d, clk, enable);

always begin
#5 clk = ~clk;

end

initial
#1 $monitor("%5d: clk=%b,d=%d,z=%d,expect=%d", $time,clk,d,z, e);

initial begin 
clk=0;
flag = $value$plusargs("enable=%b", enable);

repeat (20) begin
#2 d = $random;
end
$finish; 

end 

endmodule

我得到的输出：

    1: clk=0,d=         x,z=         x,expect=         x
    2: clk=0,d= 303379748,z=         x,expect=         x
    4: clk=0,d=3230228097,z=         x,expect=         x
    5: clk=1,d=3230228097,z=3230228097,expect=         x
    6: clk=1,d=2223298057,z=3230228097,expect=         x
    8: clk=1,d=2985317987,z=3230228097,expect=         x
   10: clk=0,d= 112818957,z=3230228097,expect=         x
   12: clk=0,d=1189058957,z=3230228097,expect=         x
   14: clk=0,d=2999092325,z=3230228097,expect=         x
   15: clk=1,d=2999092325,z=2999092325,expect=         x
   16: clk=1,d=2302104082,z=2999092325,expect=         x
   18: clk=1,d=  15983361,z=2999092325,expect=         x
   20: clk=0,d= 114806029,z=2999092325,expect=         x
   22: clk=0,d= 992211318,z=2999092325,expect=         x
   24: clk=0,d= 512609597,z=2999092325,expect=         x
   25: clk=1,d= 512609597,z= 512609597,expect=         x
   26: clk=1,d=1993627629,z= 512609597,expect=         x
   28: clk=1,d=1177417612,z= 512609597,expect=         x
   30: clk=0,d=2097015289,z= 512609597,expect=         x
   32: clk=0,d=3812041926,z= 512609597,expect=         x
   34: clk=0,d=3807872197,z= 512609597,expect=         x
   35: clk=1,d=3807872197,z=3807872197,expect=         x
   36: clk=1,d=3574846122,z=3807872197,expect=         x
   38: clk=1,d=1924134885,z=3807872197,expect=         x
   40: clk=0,d=3151131255,z=3807872197,expect=         x

此输出的第 6 行需要为“2223298057”，但即使其 clk 设置为“1”，仍具有先前的“z”值。

我怎样才能解决这个问题？

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2 回答 2

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您的收银机已经正常工作。寄存器是边沿触发的；在时间步长 5 和 6 之间没有时钟沿z，因此 的值不会更新。

如果您想z在时钟为高电平时持续更新，您需要一个锁存器，而不是一个寄存器。但是请注意，在包含锁存器的设计中，时序分析要困难得多，因此通常应该避免使用它们。

于 2016-03-22T20:22:06.950 回答
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从您提供的输出的行为看来，

register #(32) mine(z, d, clk, enable);

是一组 32 个 D 型触发器，它给出了它的名字和你连接的信号的名字似乎也是如此。如果您提供了register.

因此，如果register确实是一组 32 个 D 型触发器，则您不会期望z在时间 6 发生变化。这不是任何类型的触发器的行为方式：触发器的输出仅在一个 (上升或下降）时钟的边缘。

鉴于这些 D 型触发器在你开始这个练习之前就已经存在，看起来你的变化d太快了。您应该每时钟 ( clk) 周期更改一次，即每#10. 换句话说，尝试改变

#2 d = $random;

至

#10 d = $random;
于 2016-03-22T20:26:11.003 回答