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我正在研究 ARM 中的通用中断控制器(GIC),当我读到 GIC 的时钟频率时,它指出 GIC 的时钟频率比主核心时钟频率小整数倍。有人可以解释为什么会这样吗?
高速电路的设计、制造和控制要困难得多。因此,如果速度不是那么重要(就像您的 GIC 一样),内核外围设备的运行速度通常会比内核本身慢很多。即使是 L2-Cache 通常也不能以全核心速度运行。
此外,拥有更快时钟的 GIC 所带来的收益可能可以忽略不计,因此设计师没有理由进行新一代的开发,这在该行业中始终是一项昂贵且冒险的冒险。