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我想为一个大学项目创建一个用 Ruby 编写的 Verilog 解析器
我知道有像 Bison 和 Yacc 这样的解析器生成器。
谁能给我一些关于如何开始的建议?
我已经有一个用 ruby 编写的非常基本的 verilog 解析器(gem),称为verilog,如果您可以考虑为它做出贡献,或者它可能会给出如何开始的想法。
我还有一个名为 rubyit 的 gem ,它是一个命令行实用程序,用于使用 erb 解析文件并生成文件的标准版本。它可用于可扩展的 verilog 模板,类似于生成语句,但提供了灵活的端口列表和检查生成代码的能力。
Ruby 也确实存在解析器生成器,例如racc。开始安装 racc gem 并阅读包含的文档和示例。