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我已经实现了一个 2 次方的分频器。现在我有兴趣用从 1 到 16 的任何整数进行分频器。是的,我已经尝试过,但还没有想法。我该如何解决这个问题?
我想使用多路复用器、触发器等常见元素。不要求一个完整的解决方案,即使它会很棒。
这通常是 PLL 的工作,许多 FPGA 在片上都有一些 PLL。
或者尝试在达到限制 (0-15) 时重置的计数器。每个时间限制都达到切换时钟。1:1 时钟的值需要特殊处理,可能是时钟旁路。更好的方法是以双倍频率运行计数器以避免多路复用器。
将配置值加载为零的递减计数器也可以代替递增计数器。